本書為“十二五”普通高等教育本科規(guī)劃教材，曾榮獲全國高等學校優(yōu)秀教材獎、優(yōu)秀教材全國特等獎、科技進步二等獎和優(yōu)秀教材一等獎。 本次修訂進一步弱化了中規(guī)模器件屬性，突出了組合與時序基本單元模塊的原理，加強了用Verilog HDL設(shè)計實現(xiàn)邏輯電路的相關(guān)內(nèi)容，A/D、D/A轉(zhuǎn)換器的內(nèi)容更加貼近實際應用。 全書共11章,分別是:數(shù)字邏輯概論,邏輯代數(shù)與硬件描述語言基礎(chǔ),邏輯門電路,組合邏輯電路,鎖存器和觸發(fā)器,時序邏輯電路,半導體存儲器, FPGA和CPLD,脈沖波形的變換與產(chǎn)生,數(shù)模與模數(shù)轉(zhuǎn)換器,數(shù)字系統(tǒng)設(shè)計基礎(chǔ)。附錄中列出電氣簡圖用圖形符號 二進制邏輯單元(GB/T 4728.12—2008)簡介,常用邏輯符號對照表, 編寫Verilog HDL測試模塊。 本書可作為高等學校電氣類、電子信息類、自動化類等專業(yè)“數(shù)字電子技術(shù)基礎(chǔ)”課程的教材,也可供相關(guān)工程技術(shù)人員參考。