第1章 數(shù)字電路基礎
1.1 數(shù)字信號與數(shù)字電路
1.2 數(shù)制
1.2.1 十進制數(shù)
1.2.2 二進制數(shù)
1.2.3 十六進制數(shù)
1.2.4 不同數(shù)制之間的轉(zhuǎn)換
1.3 補碼
1.4 編碼
1.4.1 十進制代碼
1.4.2 循環(huán)碼
1.4.3 ASCII碼
本章小結(jié)
習題
第2章 邏輯代數(shù)
2.1 邏輯運算
2.1.1 與邏輯
2.1.2 或邏輯
2.1.3 非邏輯
2.1.4 兩種復合邏輯
2.1.5 兩種特殊邏輯
2.2 邏輯代數(shù)中的公式
2.2.1 基本公式
2.2.2 常用公式
2.2.3 異或邏輯的應用
2.3 三種規(guī)則
2.3.1 代人規(guī)則
2.3.2 反演規(guī)則
2.3.3 對偶規(guī)則
2.4 邏輯函數(shù)的表示方法
2.4.1 真值表
2.4.2 函數(shù)表達式
2.4.3 邏輯圖
2.4.4 表示方法的相互轉(zhuǎn)換
2.5 邏輯函數(shù)的標準形式
2.5.1 標準與或式
2.5.2 標準或與式
2.5.3 兩種標準形式的關系
2.6 邏輯函數(shù)的化簡
2.6.1 公式化簡法
2.6.2 卡諾圖化簡法
2.6.3 Q-M化簡法
2.7 無關項及其應用
2.8 硬件描述語言
2.8.1 模塊的基本結(jié)構(gòu)
2.8.2 Verilog語法元素
2.8.3 數(shù)據(jù)類型
本章小結(jié)
習題
第3章 門電路
3.1 分立器件門電路
3.1.1 二極管與門
3.1.2 二極管或門
3.1.3 三極管反相器
3.2 集成邏輯門
3.2.1 CMOS反相器
3.2.2 其他CMOS邏輯門
3.2.3 TTL邏輯門
3.3 兩種特殊門電路
3.3.1 OC/OD門
3.3.2 三態(tài)門
3.4 CMOS傳輸門
3.5 Verilog的基元和操作符
3.5.1 Verilog的基元
3.5.2 操作符
3.6 設計實踐
本章小結(jié)
習題
第4章 組合邏輯電路
4.1 組合邏輯電路概述
4.2 組合電路的分析與設計
4.2.1 組合電路設計
4.2.2 組合電路分析
4.3 常用組合邏輯器件
4.3.1 編碼器
4.3.2 譯碼器
4.3.3 數(shù)據(jù)選擇器與數(shù)據(jù)分配器
4.3.4 加法器
4.3.5 數(shù)值比較器
4.3.6 奇偶校驗器
4.4 組合電路中的競爭-冒險
4.4.1 競爭-冒險的概念
4.4.2 競爭-冒險的檢查方法
4.4.3 競爭-冒險的消除方法
4.5 邏輯功能的三種描述方法
4.5.1 結(jié)構(gòu)描述
4.5.2 數(shù)據(jù)流描述
4.5.3 行為描述
4.6 設計實踐
4.6.1 門電路功能實驗電路
4.6.2 二進制數(shù)-BCD碼轉(zhuǎn)換
本章小結(jié)
習題
第5章 鎖存器與觸發(fā)器
5.1 基本鎖存器及其功能描述方法
5.2 門控鎖存器
5.3 脈沖觸發(fā)器
5.4 邊沿觸發(fā)器
5.5 鎖存器與觸發(fā)器的邏輯功能和動作特點
5.6 鎖存器與觸發(fā)器的動態(tài)特性
5.6.1 門控鎖存器的動態(tài)特性
5.6.2 邊沿觸發(fā)器的動態(tài)特性
5.7 鎖存器和觸發(fā)器的描述
5.7.1 鎖存器的描述
5.7.2 觸發(fā)器的描述
5.8 設計實踐
本章小結(jié)
習題
第6章 時序邏輯電路
6.1 時序邏輯電路概述
6.2 時序電路的功能描述
6.2.1 狀態(tài)轉(zhuǎn)換表
6.2.2 狀態(tài)轉(zhuǎn)換圖
6.2.3 時序圖
6.3 時序電路的分析與設計
6.3.1 時序電路分析
6.3.2 時序電路設計
6.4 寄存器與移位寄存器
6.4.1 寄存器
6.4.2 移位寄存器
6.5 計數(shù)器
6.5.1 同步計數(shù)器設計
6.5.2 異步計數(shù)器分析
6.5.3 任意進制計數(shù)器
6.5.4 兩種特殊計數(shù)器
6.6 兩種時序單元電路
6.6.1 頁序脈沖發(fā)生器
6.6.2 序列信號產(chǎn)生器
6.7 時序電路中的競爭-冒險
6.7.1 時鐘脈沖的特性
6.7.2 時序電路可靠工作的條件
6.8 時序邏輯電路的描述
6.8.1 寄存器的描述
6.8.2 計數(shù)器的描述
6.8.3 一般時序電路的描述
6.9 設計實踐
6.9.1 交通燈控制器設計
6.9.2 數(shù)字頻率計設計
6.9.3 序列控制電路設計
本章小結(jié)
習題
第7章 半導體存儲器
7.1 ROM
7.2 RAM
7.2.1 SRAM
7.2.2 DRAM
7.3 存儲容量的擴展
7.4 ROM的應用
7.4.1 實現(xiàn)組合邏輯函數(shù)
7.4.2 進行代碼轉(zhuǎn)換
7.4.3 構(gòu)成函數(shù)發(fā)生器
7.5 可編程邏輯器件
7.5.1 基于乘積項結(jié)構(gòu)的PLD
7.5.2 基于查找表結(jié)構(gòu)的FPGA
7.6 存儲器的描述
7.7 設計實踐
7.7.1 DDS信號源設計
7.7.2 LED點陣驅(qū)動電路設計
本章小結(jié)
習題
第8章 脈沖電路
8.1 描述脈沖的主要參數(shù)
8.2 555定時器及應用
8.2.1 施密特電路
8.2.2 單穩(wěn)態(tài)電路
8.2.3 多諧振蕩器
8.3 設計實踐
8.3.1 音頻脈沖電路設計
8.3.2 簡易電子琴設計
本章小結(jié)
習題
第9章 D/A和A/D轉(zhuǎn)換器
9.1 D/A轉(zhuǎn)換器
9.1.1 權(quán)電阻網(wǎng)絡D/A轉(zhuǎn)換器
9.1.2 梯形電阻網(wǎng)絡D/A轉(zhuǎn)換器
9.1.3 D/A轉(zhuǎn)換器的性能指標
9.1.4 雙極性D/A轉(zhuǎn)換方法
9.2 A/D轉(zhuǎn)換器
……