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Cadence高速電路板設(shè)計(jì)與仿真(第7版)——信號(hào)與電源完整性分析

Cadence高速電路板設(shè)計(jì)與仿真(第7版)——信號(hào)與電源完整性分析

定  價(jià):108 元

叢書(shū)名:EDA應(yīng)用技術(shù)

        

  • 作者:徐宏偉
  • 出版時(shí)間:2024/3/1
  • ISBN:9787121474453
  • 出 版 社:電子工業(yè)出版社
  • 中圖法分類(lèi):TN410.2 
  • 頁(yè)碼:392
  • 紙張:
  • 版次:01
  • 開(kāi)本:16開(kāi)
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讀者對(duì)象:本書(shū)適合對(duì)高速PCB設(shè)計(jì)有一定基礎(chǔ)的中、高級(jí)讀者閱讀,也可作為高等學(xué)校相關(guān)專(zhuān)業(yè)及培訓(xùn)機(jī)構(gòu)的教學(xué)用書(shū)。

隨著現(xiàn)代科學(xué)技術(shù)的飛速發(fā)展,器件的集成度大規(guī)模提高,各類(lèi)數(shù)字器件的信號(hào)沿也越來(lái)越陡,已經(jīng)達(dá)到納秒(ns)級(jí)。如此高速的信號(hào)切換對(duì)系統(tǒng)設(shè)計(jì)者而言,必須考慮在低頻電路設(shè)計(jì)中所無(wú)須考慮的信號(hào)完整性(Signal Integrity)問(wèn)題,如延時(shí)、串?dāng)_、反射及傳輸線(xiàn)之間的耦合等。本書(shū)以Cadence Allegro SPB 17.4為基礎(chǔ),以具體的高速PCB為范例,詳細(xì)講解了高速PCB設(shè)計(jì)知識(shí)、仿真前的準(zhǔn)備工作、約束驅(qū)動(dòng)布局、約束驅(qū)動(dòng)布線(xiàn)、差分對(duì)設(shè)計(jì)、模型與拓?fù)、板?jí)仿真、AMI生成器、仿真DDR4、集成直流電源解決方案、分析模型管理器和協(xié)同仿真、電源完整性?xún)?yōu)化設(shè)計(jì)、其他增強(qiáng)及AMM和PDC結(jié)合等內(nèi)容。
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